Switch level timing simulation mos de rao vasant (21 resultados)
Switch-Level Timing Simulation of MOS VLSI Circuits (The Kluwer International Series in Engineering and Computer Science; 66. VLSI, Computer Architecture and Digital Signal Processing)
Rao, Vasant; Overhauser, David; Trick, Timothy; Hajj, Ibrahim
Idioma: Inglés
Editorial: Kluwer Academic Publishers, Norwell, Massachusetts, U.S.A., 1989
- Tapa dura
- Primera edición
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hardcover. Condición: Very Good. No Dust Jacket. First Edition. White hardcover with black lettering on spine and upper board and contents in very good clean condition, showing minimal signs of wear. Previous owner's name on FEP. Profusely illustrated by diagrams and tables. No dust jacket. T. Used.
Switch-Level Timing Simulation of MOS VLSI Circuits
Overhauser, David V., Rao, Vasant B., Trick, Timothy, Hajj, Ibrahim N.
- Tapa dura
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- Tapa dura
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Hardcover. Condición: Good. No Jacket. Pages can have notes/highlighting. Spine may show signs of wear. ~ ThriftBooks: Read More, Spend Less.
Switch-level Timing Simulation of Mos Vlsi Circuits
Rao, Vasant B.; Overhauser, David V.; Trick, Timothy N.; Hajj, Ibrahim N.
- Tapa blanda
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Switch-Level Timing Simulation of MOS VLSI Circuits (The Springer International Series in Engineering and Computer Science, 66)
Rao, Vasant B.; Overhauser, David V.; Trick, Timothy N.; Hajj, Ibrahim N.
- Tapa dura
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Condición: New. Series: The Springer International Series in Engineering and Computer Science. Num Pages: 210 pages, biography. BIC Classification: TJFC. Category: (P) Professional & Vocational; (UP) Postgraduate, Research & Scholarly. Dimension: 234 x 156 x 14. Weight in Grams: 493. . 1988. Hardback. . . . . …
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Condición: New. pp. 224.
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Condición: New. Series: The Springer International Series in Engineering and Computer Science. Num Pages: 210 pages, biography. BIC Classification: TJFC. Category: (P) Professional & Vocational; (UP) Postgraduate, Research & Scholarly. Dimension: 234 x 156 x 14. Weight in Grams: 493. . 1988. Hardback. . . . . Books ship from the US and Ireland. …
Switch-Level Timing Simulation of MOS VLSI Circuits
Vasant B. Rao|David V. Overhauser|Timothy N. Trick|Ibrahim N. Hajj
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Condición: New. Only two decades ago most electronic circuits were designed with a slide-rule, and the designs were verified using breadboard techniques. Simulation tools were a research curiosity and in general were mistrusted by most designers and test engineers. In thos.
Switch-Level Timing Simulation of MOS VLSI Circuits
Vasant B. Rao|David V. Overhauser|Timothy N. Trick|Ibrahim N. Hajj
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Condición: New. Only two decades ago most electronic circuits were designed with a slide-rule, and the designs were verified using breadboard techniques. Simulation tools were a research curiosity and in general were mistrusted by most designers and test engineers. In thos.
Switch-Level Timing Simulation of MOS VLSI Circuits (The Springer International Series in Engineering and Computer Science, 66)
Rao, Vasant B., Overhauser, David V., Trick, Timothy N., Haj
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Switch-Level Timing Simulation of MOS VLSI Circuits (The Springer International Series in Engineering and Computer Science (66))
Rao, Vasant B., Overhauser, David V., Trick, Timothy N., Haj
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Switch-level Timing Simulation of Mos Vlsi Circuits
Rao, Vasant B.; Overhauser, David V.; Trick, Timothy N.; Hajj, Ibrahim N.
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Condición: New. Print on Demand pp. 224 52:B&W 6.14 x 9.21in or 234 x 156mm (Royal 8vo) Case Laminate on White w/Gloss Lam.
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Condición: New. PRINT ON DEMAND pp. 224.
