9783319743813 - parasitic substrate coupling in high voltage integrated circuits: minority and majority carriers propagation in semiconductor substrate (analog circuits and signal processing) de buccella (20 resultados)
Idioma: Inglés
Editorial: Springer, 2018
Serie: Libro 108 de 124 - Analog Circuits and Signal Processing
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Parasitic Substrate Coupling in High Voltage Integrated Circuits : Minority and Majority Carriers Propagation in Semiconductor Substrate
Buccella, Pietro; Stefanucci, Camillo; Kayal, Maher; Sallese, Jean-michel
Idioma: Inglés
Editorial: Springer, 2018
Serie: Libro 108 de 124 - Analog Circuits and Signal Processing
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Idioma: Inglés
Editorial: Springer, 2018
Serie: Libro 108 de 124 - Analog Circuits and Signal Processing
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Parasitic Substrate Coupling in High Voltage Integrated Circuits : Minority and Majority Carriers Propagation in Semiconductor Substrate
Buccella, Pietro; Stefanucci, Camillo; Kayal, Maher; Sallese, Jean-michel
Idioma: Inglés
Editorial: Springer, 2018
Serie: Libro 108 de 124 - Analog Circuits and Signal Processing
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Parasitic Substrate Coupling in High Voltage Integrated Circuits : Minority and Majority Carriers Propagation in Semiconductor Substrate
Buccella, Pietro; Stefanucci, Camillo; Kayal, Maher; Sallese, Jean-michel
Idioma: Inglés
Editorial: Springer, 2018
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Editorial: Springer, 2018
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Parasitic Substrate Coupling in High Voltage Integrated Circuits : Minority and Majority Carriers Propagation in Semiconductor Substrate
Buccella, Pietro; Stefanucci, Camillo; Kayal, Maher; Sallese, Jean-michel
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Editorial: Springer, 2018
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Idioma: Inglés
Editorial: Springer, 2018
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Idioma: Inglés
Editorial: Springer, 2018
Serie: Libro 108 de 124 - Analog Circuits and Signal Processing
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Condición: Hervorragend. Zustand: Hervorragend | Sprache: Englisch | Produktart: Bücher | This book introduces a new approach to model and predict substrate parasitic failures in integrated circuits with standard circuit design tools. The injection of majority and minority carriers in the substrate is a recurring problem in smar…t power ICs containing high voltage, high current switching devices besides sensitive control, protection and signal processing circuits. The injection of parasitic charges leads to the activation of substrate bipolar transistors. This book explores how these events can be evaluated for a wide range of circuit topologies. To this purpose, new generalized devices implemented in Verilog-A are used to model the substrate with standard circuit simulators. This approach was able to predict for the first time the activation of a latch-up in real circuits through post-layout SPICE simulation analysis. Discusses substrate modeling and circuit-level simulation of parasitic bipolar device coupling effects in integrated circuits; Includes circuit back-annotation of the parasitic lateral n-p-n and vertical p-n-p bipolar transistors in the substrate; Uses Spice for simulation and characterization of parasitic bipolar transistors, latch-up of the parasitic p-n-p-n structure, and electrostatic discharge (ESD) protection devices; Offers design guidelines to reduce couplings by adding specific protections.
Idioma: Inglés
Editorial: Springer, 2018
Serie: Libro 108 de 124 - Analog Circuits and Signal Processing
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Idioma: Inglés
Editorial: Springer, 2018
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Editorial: Springer, Springer, 2018
Serie: Libro 108 de 124 - Analog Circuits and Signal Processing
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Buch. Condición: Neu. Druck auf Anfrage Neuware - Printed after ordering - This book introduces a new approach to model and predict substrate parasitic failures in integrated circuits with standard circuit design tools.The injection of majority and minority carriers in the substrate is a recurring problem in smart power ICs cont…aining high voltage, high current switching devices besides sensitive control, protection and signal processing circuits.The injection of parasitic charges leads to the activation of substrate bipolar transistors. This book explores how these events can be evaluated for a wide range of circuit topologies. To this purpose, new generalized devices implemented in Verilog-A are used to model the substrate with standard circuit simulators. This approach was able to predict for the first time the activation of a latch-up in real circuits through post-layout SPICE simulation analysis.Discusses substrate modeling and circuit-level simulation of parasitic bipolar device coupling effects in integrated circuits;Includes circuit back-annotation of the parasitic lateral n-p-n and vertical p-n-p bipolar transistors in the substrate;Uses Spice for simulation and characterization of parasitic bipolar transistors, latch-up of the parasitic p-n-p-n structure, and electrostatic discharge (ESD) protection devices;Offers design guidelines to reduce couplings by adding specific protections.
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Editorial: Springer, 2018
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Editorial: Springer, 2018
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Editorial: Springer International Publishing Mrz 2018, 2018
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Buch. Condición: Neu. This item is printed on demand - it takes 3-4 days longer - Neuware -This book introduces a new approach to model and predict substrate parasitic failures in integrated circuits with standard circuit design tools.The injection of majority and minority carriers in the substrate is a recurring problem in smar…t power ICs containing high voltage, high current switching devices besides sensitive control, protection and signal processing circuits.The injection of parasitic charges leads to the activation of substrate bipolar transistors. This book explores how these events can be evaluated for a wide range of circuit topologies. To this purpose, new generalized devices implemented in Verilog-A are used to model the substrate with standard circuit simulators. This approach was able to predict for the first time the activation of a latch-up in real circuits through post-layout SPICE simulation analysis.Discusses substrate modeling and circuit-level simulation of parasitic bipolar device coupling effects in integrated circuits;Includes circuit back-annotation of the parasitic lateral n-p-n and vertical p-n-p bipolar transistors in the substrate;Uses Spice for simulation and characterization of parasitic bipolar transistors, latch-up of the parasitic p-n-p-n structure, and electrostatic discharge (ESD) protection devices;Offers design guidelines to reduce couplings by adding specific protections. 204 pp. Englisch.
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Parasitic Substrate Coupling in High Voltage Integrated Circuits
Pietro Buccella|Camillo Stefanucci|Maher Kayal|Jean-Michel Sallese
Idioma: Inglés
Editorial: Springer International Publishing, 2018
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Condición: New. Dieser Artikel ist ein Print on Demand Artikel und wird nach Ihrer Bestellung fuer Sie gedruckt. Discusses substrate modeling and circuit-level simulation of parasitic bipolar device coupling effects in integrated circuits Includes circuit back-annotation of the parasitic lateral n-p-n and vertical p-n-p bipolar…transistors in the substrate.
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Editorial: Springer, 2018
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Editorial: Springer, 2018
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Editorial: Springer, Palgrave Macmillan Mär 2018, 2018
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Buch. Condición: Neu. This item is printed on demand - Print on Demand Titel. Neuware -This book introduces a new approach to model and predict substrate parasitic failures in integrated circuits with standard circuit design tools.The injection of majority and minority carriers in the substrate is a recurring problem in smart po…wer ICs containing high voltage, high current switching devices besides sensitive control, protection and signal processing circuits.The injection of parasitic charges leads to the activation of substrate bipolar transistors. This book explores how these events can be evaluated for a wide range of circuit topologies. To this purpose, new generalized devices implemented in Verilog-A are used to model the substrate with standard circuit simulators. This approach was able to predict for the first time the activation of a latch-up in real circuits through post-layout SPICE simulation analysis.Discusses substrate modeling and circuit-level simulation of parasitic bipolar device coupling effects in integrated circuits;Includes circuit back-annotation of the parasitic lateral n-p-n and vertical p-n-p bipolar transistors in the substrate;Uses Spice for simulation and characterization of parasitic bipolar transistors, latch-up of the parasitic p-n-p-n structure, and electrostatic discharge (ESD) protection devices;Offers design guidelines to reduce couplings by adding specific protections.Springer-Verlag KG, Sachsenplatz 4-6, 1201 Wien 204 pp. Englisch.
