Misha siddhi (32 resultados)
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Taschenbuch. Condición: Neu. nach der Bestellung gedruckt Neuware - Printed after ordering - Conventional 24x24 multiply architectures are implemented in floating point multipliers using array multipliers, redundant binary architectures( Pipeline Stages), modified booth encoding, a binary tree of 4:2 Compressors (Wallace tree) a…nd modified carry save array in conjunction with Booth's algorithm. There are number of problems associated with tree and array multipliers. Tree multipliers have many problems like shortest logic delay but irregular layouts with complicated interconnects, irregular layouts not only demand more physical design effort, but also introduce significant interconnect delay. Similarly, array multipliers has also some drawbacks associated with them such as they have larger delay and offer regular layout with simpler interconnects. Also significant amount of power consumption as reconfigurability at run time is not provided according to the input bit width. In order to remove the above problems, Urdhvatriyakbhyam algorithm of ancient Indian Vedic Mathematics is utilized. Simulation of 32-bit Floating Point Multiplier and application of Vedic Mathematics is an important part of this dissertation.
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Condición: New. Dieser Artikel ist ein Print on Demand Artikel und wird nach Ihrer Bestellung fuer Sie gedruckt. Autor/Autorin: Kumar AbhijeetAbhijeet Kumar - Assistant Professor, M M University, Mullana, AmbalaM.E, Punjab Engineering College, Chandigarh, B.E, SLIET, Longowal.Conventional 24x24 multiply architectures are impleme…nted in floating point mult.
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Taschenbuch. Condición: Neu. nach der Bestellung gedruckt Neuware - Printed after ordering - Las arquitecturas de multiplicación convencionales 24x24 se implementan en multiplicadores de punto flotante utilizando multiplicadores de matriz, arquitecturas binarias redundantes (etapas de canalización), codificación Booth modificada…, un árbol binario de compresores 4:2 (árbol de Wallace) y una matriz de ahorro de acarreo modificada junto con el algoritmo de Booth. Existen varios problemas asociados con los multiplicadores de árbol y de matriz. Los multiplicadores de árbol tienen muchos problemas, como el menor retraso lógico, pero diseños irregulares con interconexiones complicadas. Los diseños irregulares no solo exigen un mayor esfuerzo de diseño físico, sino que también introducen un retraso significativo en las interconexiones. Del mismo modo, los multiplicadores de matriz también tienen algunos inconvenientes asociados, como un mayor retraso y un diseño regular con interconexiones más simples. Además, consumen una cantidad significativa de energía, ya que no se proporciona reconfigurabilidad en tiempo de ejecución según el ancho de bits de entrada. Para eliminar los problemas anteriores, se utiliza el algoritmo Urdhvatriyakbhyam de la antigua matemática védica india. La simulación del multiplicador de punto flotante de 32 bits y la aplicación de la matemática védica son una parte importante de esta tesis.
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Taschenbuch. Condición: Neu. nach der Bestellung gedruckt Neuware - Printed after ordering - Les architectures de multiplication 24x24 conventionnelles sont mises en oeuvre dans des multiplicateurs à virgule flottante à l'aide de multiplicateurs matriciels, d'architectures binaires redondantes (étages de pipeline), d'un codage B…ooth modifié, d'un arbre binaire de compresseurs 4:2 (arbre de Wallace) et d'un tableau de sauvegarde de report modifié en conjonction avec l'algorithme de Booth. Les multiplicateurs matriciels et arborescents posent un certain nombre de problèmes. Les multiplicateurs en arbre présentent de nombreux problèmes, tels qu'un délai logique minimal mais des configurations irrégulières avec des interconnexions complexes. Les configurations irrégulières exigent non seulement plus d'efforts de conception physique, mais introduisent également un délai d'interconnexion important. De même, les multiplicateurs matriciels présentent également certains inconvénients, tels qu'un délai plus important et une configuration régulière avec des interconnexions plus simples. Ils consomment également beaucoup d'énergie, car la reconfigurabilité à l'exécution n'est pas fournie en fonction de la largeur de bit d'entrée. Afin de résoudre les problèmes ci-dessus, l'algorithme Urdhvatriyakbhyam de l'ancienne mathématique védique indienne est utilisé. La simulation d'un multiplicateur à virgule flottante 32 bits et l'application de la mathématique védique constituent une partie importante de cette thèse.
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Taschenbuch. Condición: Neu. nach der Bestellung gedruckt Neuware - Printed after ordering - Konwencjonalne architektury mno¿enia 24x24 s¿ implementowane w mno¿nikach zmiennoprzecinkowych przy u¿yciu mno¿ników tablicowych, redundantnych architektur binarnych (etapy potokowe), zmodyfikowanego kodowania Bootha, drzewa binarnego ko…mpresorów 4:2 (drzewo Wallace'a) oraz zmodyfikowanej tablicy przeniesienia w po¿¿czeniu z algorytmem Bootha. Istnieje szereg problemów zwi¿zanych z mno¿nikami drzewiastymi i tablicowymi. Mno¿niki drzewiaste maj¿ wiele problemów, takich jak najkrótsze opó¿nienie logiczne, ale nieregularne uk¿ady z skomplikowanymi po¿¿czeniami, nieregularne uk¿ady nie tylko wymagaj¿ wi¿kszego wysi¿ku fizycznego przy projektowaniu, ale tak¿e powoduj¿ znaczne opó¿nienia w po¿¿czeniach. Podobnie, mno¿niki tablicowe maj¿ równie¿ pewne wady, takie jak wi¿ksze opó¿nienia i regularny uk¿ad z prostszymi po¿¿czeniami. Ponadto zu¿ywaj¿ one znaczn¿ ilo¿¿ energii, poniewä nie zapewniaj¿ rekonfigurowalno¿ci w czasie pracy zgodnie z szeroko¿ci¿ bitow¿ wej¿cia. Aby wyeliminowä powy¿sze problemy, wykorzystuje si¿ algorytm Urdhvatriyakbhyam ze staro¿ytnej indyjskiej matematyki wedyjskiej. Symulacja 32-bitowego mno¿nika zmiennoprzecinkowego i zastosowanie matematyki wedyjskiej stanowi wän¿ cz¿¿¿ niniejszej rozprawy.
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Taschenbuch. Condición: Neu. nach der Bestellung gedruckt Neuware - Printed after ordering - As arquiteturas convencionais de multiplicação 24x24 são implementadas em multiplicadores de ponto flutuante usando multiplicadores de matriz, arquiteturas binárias redundantes (Pipeline Stages), codificação Booth modificada, uma árvore…binária de compressores 4:2 (árvore Wallace) e matriz de carry save modificada em conjunto com o algoritmo de Booth. Existem vários problemas associados aos multiplicadores de árvore e matriz. Os multiplicadores em árvore têm muitos problemas, como o menor atraso lógico, mas layouts irregulares com interconexões complicadas. Layouts irregulares não só exigem mais esforço de design físico, mas também introduzem um atraso significativo na interconexão. Da mesma forma, os multiplicadores em matriz também têm algumas desvantagens associadas a eles, como maior atraso e layout regular com interconexões mais simples. Além disso, há um consumo significativo de energia, uma vez que a reconfigurabilidade em tempo de execução não é fornecida de acordo com a largura de bits de entrada. Para eliminar os problemas acima, é utilizado o algoritmo Urdhvatriyakbhyam da antiga matemática védica indiana. A simulação do multiplicador de ponto flutuante de 32 bits e a aplicação da matemática védica são uma parte importante desta dissertação.
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Taschenbuch. Condición: Neu. nach der Bestellung gedruckt Neuware - Printed after ordering - Le architetture di moltiplicazione convenzionali 24x24 sono implementate in moltiplicatori in virgola mobile utilizzando moltiplicatori array, architetture binarie ridondanti (stadi pipeline), codifica Booth modificata, un albero binario… di compressori 4:2 (albero di Wallace) e un array carry save modificato in combinazione con l'algoritmo di Booth. Esistono numerosi problemi associati ai moltiplicatori ad albero e array. I moltiplicatori ad albero presentano molti problemi, come il ritardo logico più breve ma layout irregolari con interconnessioni complicate; i layout irregolari non solo richiedono uno sforzo di progettazione fisica maggiore, ma introducono anche un ritardo di interconnessione significativo. Allo stesso modo, anche i moltiplicatori ad array presentano alcuni svantaggi, come un ritardo maggiore e un layout regolare con interconnessioni più semplici. Inoltre, il consumo energetico è significativo poiché la riconfigurabilità in fase di esecuzione non è fornita in base alla larghezza di bit in ingresso. Al fine di eliminare i problemi sopra citati, viene utilizzato l'algoritmo Urdhvatriyakbhyam dell'antica matematica vedica indiana. La simulazione del moltiplicatore a virgola mobile a 32 bit e l'applicazione della matematica vedica sono una parte importante di questa tesi.
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