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Source-Synchronous Networks-On-Chip: Circuit and Architectural Interconnect Modeling - Tapa blanda

 
9781493948178: Source-Synchronous Networks-On-Chip: Circuit and Architectural Interconnect Modeling

Reseña del editor

This book describes novel methods for network-on-chip (NoC) design, using source-synchronous high-speed resonant clocks. The authors discuss NoCs from the bottom up, providing circuit level details, before providing architectural simulations. As a result, readers will get a complete picture of how a NoC can be designed and optimized. Using the methods described in this book, readers are enabled to design NoCs that are 5X better than existing approaches in terms of latency and throughput and can also sustain a significantly greater amount of traffic.

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  • EditorialSpringer
  • Año de publicación2016
  • ISBN 10 1493948172
  • ISBN 13 9781493948178
  • EncuadernaciónTapa blanda
  • IdiomaInglés
  • Número de páginas160

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Editorial: Springer, 2013
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Mandal, Ayan; Khatri, Sunil P.; Mahapatra, Rabi
Publicado por Springer, 2016
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Taschenbuch. Condición: Neu. This item is printed on demand - it takes 3-4 days longer - Neuware -This book describes novel methods for network-on-chip (NoC) design, using source-synchronous high-speed resonant clocks. The authors discuss NoCs from the bottom up, providing circuit level details, before providing architectural simulations. As a result, readers will get a complete picture of how a NoC can be designed and optimized. Using the methods described in this book, readers are enabled to design NoCs that are 5X better than existing approaches in terms of latency and throughput and can also sustain a significantly greater amount of traffic. 160 pp. Englisch. Nº de ref. del artículo: 9781493948178

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ISBN 10: 1493948172 ISBN 13: 9781493948178
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Taschenbuch. Condición: Neu. Druck auf Anfrage Neuware - Printed after ordering - This book describes novel methods for network-on-chip (NoC) design, using source-synchronous high-speed resonant clocks. The authors discuss NoCs from the bottom up, providing circuit level details, before providing architectural simulations. As a result, readers will get a complete picture of how a NoC can be designed and optimized. Using the methods described in this book, readers are enabled to design NoCs that are 5X better than existing approaches in terms of latency and throughput and can also sustain a significantly greater amount of traffic. Nº de ref. del artículo: 9781493948178

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Ayan Mandal|Sunil P. Khatri|Rabi Mahapatra
Publicado por Springer New York, 2016
ISBN 10: 1493948172 ISBN 13: 9781493948178
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Condición: New. Dieser Artikel ist ein Print on Demand Artikel und wird nach Ihrer Bestellung fuer Sie gedruckt. Describes novel methods for high-speed network-on-chip (NoC) design Enables readers to understand NoC design from both circuit and architectural levels Provides circuit-level details of the NoC (including clocking, router design), along wit. Nº de ref. del artículo: 447956041

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Ayan Mandal
Publicado por Springer-Verlag New York Inc., 2016
ISBN 10: 1493948172 ISBN 13: 9781493948178
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Mandal, Ayan/ Khatri, Sunil P./ Mahapatra, Rabi
Publicado por Springer Verlag, 2016
ISBN 10: 1493948172 ISBN 13: 9781493948178
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Paperback. Condición: Brand New. reprint edition. 156 pages. 9.25x6.10x0.38 inches. In Stock. Nº de ref. del artículo: x-1493948172

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