Prozessorentwurf mit Verilog HDL: Modellierung und Synthese von Prozessormodellen (De Gruyter Studium) (German Edition)

Wecker, Dieter

ISBN 10: 3110717824 ISBN 13: 9783110717822

Editorial: De Gruyter Oldenbourg, 2021

Idioma: Alem�n

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Detalles bibliogr�ficos

T�tulo: Prozessorentwurf mit Verilog HDL: Modellierung und Synthese von Prozessormodellen (De Gruyter Studium) (German Edition)
Editor: De Gruyter Oldenbourg
Fecha de publicaci�n: 2021
Idioma: Alem�n
ISBN 10: 3110717824
ISBN 13: 9783110717822
Encuadernaci�n: Encuadernaci�n de tapa blanda
Estado: New

Acerca de

Sinopsis

Verschiedene Entw�rfe von 12- und 16-Bit-Mikroprozessoren sowie ihre Modellierung und m�gliche Realisierung durch die Verwendung von FPGAs (Field Programmable Gate Array) werden in diesem Buch beschrieben. Dazu wird die Hardware-Beschreibungssprache Verilog HDL verwendet. In allen Phasen des Entwurfs wird der Source-Code ausf�hrlich behandelt. Die Verilog-Modelle werden auf Basis der Synthese-Berichte miteinander verglichen und Vor- und Nachteile herausgearbeitet. Die Entw�rfe wurden mit einer CAD (Computer Aided Design)-Entwicklungs-Software erstellt, die kostenlos aus dem Internet heruntergeladen werden kann. Mit den vermittelten Grundlagen kann der Leser eigene Prototypen f�r bestimmte Anwendungen erstellen. Zielgruppe des Buches sind vor allem Studierende der Fachrichtungen Informatik und Elektrotechnik sowie Entwickler, die sich in das Thema einarbeiten wollen.

Acerca del autor

Dieter Wecker, ehem. University of Applied Sciences, Frankfurt a.M.

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