A Pipelined Multi-core MIPS Machine

Idioma: inglés

Editorial: Springer International Publishing Dez 2014, 2014

3319139053 / 9783319139050

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This item is printed on demand - it takes 3-4 days longer - Neuware -This monograph is based on the third author's lectures on computer architecture, given in the summer semester 2013 at Saarland University, Germany. It contains a gate level construction of a multi-core machine with pipelined MIPS processor cores and a sequentially consistent shared memory.The book contains the first correctness proofs for both the gate level implementation of a multi-core processor and also of a cache based sequentially consistent shared memory. This opens the way to the formal verification of synthesizable hardware for multi-core processors in the future.Constructions are in a gate level hardware model and thus deterministic. In contrast the reference models against which correctness is shown are nondeterministic. The development of the additional machinery for these proofs and the correctness proof of the shared memory at the gate level are the main technical contributions of this work. 364 pp. Englisch. …

N° de ref. del artículo 9783319139050

Título
A Pipelined Multi-core MIPS Machine
Autor
Mikhail Kovalev
Editorial
Springer International Publishing Dez 2014
Año de publicación
2014
Estado
Neu
Encuadernación
Taschenbuch
Idioma
inglés
ISBN 10
3319139053
ISBN 13
9783319139050
Peso del artículo
552 gramos
Dimensiones
235x155x20 mm

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