Performance Optimization in Network-on-Chip

Idioma: inglés

Editorial: LAP LAMBERT Academic Publishing Jun 2016, 2016

3659907456 / 9783659907456

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This item is printed on demand - it takes 3-4 days longer - Neuware -The increasing complexity of System-on-Chips (SoCs) has resulted in the bottlenecking of the system due to scalability problems in the bus system. This leads to the decrement of performance of future SoCs with more complex circuitries inside them. Network-on-Chips (NoCs) was proposed as one of the solutions to overcome these issues especially regarding the communication between Intellectual Properties (IP) in a chip. The fundamentals in designing NoC include the selection of network topologies, and hence, performance optimization is needed to ensure the full advantage of networking is taken. Therefore, multi-level Network Partitioning techniques are proposed to obtain the optimal design of networks based on its performance. The performance of a network is measured by its throughput, average queue size, waiting time and data loss. This technique is applied in a case study using MPEG-4 video application. The proposed technique is expected to enhance the performance of the NoC. 80 pp. Englisch.…

N° de ref. del artículo 9783659907456

Título
Performance Optimization in Network-on-Chip
Autor
Asrani Lit
Editorial
LAP LAMBERT Academic Publishing Jun 2016
Año de publicación
2016
Estado
Neu
Encuadernación
Taschenbuch
Idioma
inglés
ISBN 10
3659907456
ISBN 13
9783659907456
Peso del artículo
137 gramos
Dimensiones
220x150x6 mm

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