Logic Synthesis and Verification Algorithms

Somenzi Fabio Hachtel Gary D.

ISBN 10: 1475770367 ISBN 13: 9781475770360

Editorial: Springer, 2013

Idioma: Ingl�s

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Descripci�n

pp. 600 66:B&W 7 x 10 in or 254 x 178 mm Perfect Bound on White w/Gloss Lam.

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Detalles bibliogr�ficos

T�tulo

Logic Synthesis and Verification Algorithms

Editor

Springer

Fecha de publicaci�n

2013

Idioma

Ingl�s

ISBN 10

1475770367

ISBN 13

9781475770360

Encuadernaci�n

Encuadernaci�n de tapa blanda

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Acerca de

Sinopsis

Logic Synthesis and Verification Algorithms is a textbook designed for courses on VLSI Logic Synthesis and Verification, Design Automation, CAD and advanced level discrete mathematics. It also serves as a basic reference work in design automation for both professionals and students.
Logic Synthesis and Verification Algorithms is about the theoretical underpinnings of VLSI (Very Large Scale Integrated Circuits). It combines and integrates modern developments in logic synthesis and formal verification with the more traditional matter of Switching and Finite Automata Theory. The book also provides background material on Boolean algebra and discrete mathematics.
A unique feature of this text is the large collection of solved problems.
Throughout the text the algorithms covered are the subject of one or more problems based on the use of available synthesis programs.

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