Emerging VLSI Devices, Circuits and Architectures
Idioma: inglés
Editorial: Springer, Springer Okt 2024, 2024
- Tapa dura
- Nuevo
Librería: BuchWeltWeit Ludwig Meier e.K., Bergisch Gladbach, AlemaniaBuchWeltWeit Ludwig Meier e.K.
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This item is printed on demand - it takes 3-4 days longer - Neuware -This book constitutes the proceedings of the 27th International Symposium on VLSI Design and Test, VDAT 2023. The 32 regular papers and 16 short papers presented in this book are carefully reviewed and selected from 220 submissions. They are organized in topical sections as follows: Low-Power Integrated Circuits and Devices; FPGA-Based Design and Embedded Systems; Memory, Computing, and Processor Design; CAD for VLSI; Emerging Integrated Circuits and Systems; VLSI Testing and Security; and System-Level Design. 372 pp. Englisch.
N° de ref. del artículo 9789819752683
- Título
- Emerging VLSI Devices, Circuits and Architectures
- Autor
- Anu Gupta
- Editorial
- Springer, Springer Okt 2024
- Año de publicación
- 2024
- Estado
- Neu
- Encuadernación
- Buch
- Idioma
- inglés
- ISBN 10
- 981975268X
- ISBN 13
- 9789819752683
- Peso del artículo
- 790 gramos
- Dimensiones
- 241x160x25 mm
This book constitutes the proceedings of the 27th International Symposium on VLSI Design and Test, VDAT 2023. The 32 regular papers and 16 short papers presented in this book are carefully reviewed and selected from 220 submissions. They are organized in topical sections as follows: Low-Power Integrated Circuits and Devices; FPGA-Based Design and Embedded Systems; Memory, Computing, and Processor Design; CAD for VLSI; Emerging Integrated Circuits and Systems; VLSI Testing and Security; and System-Level Design.
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Acerca del autor
Prof. Anu Gupta received M.E and Ph.D. degrees from Birla Institute of Technology and Science (BITS) Pilani, in 1995 and 2003 respectively. In 1995, she joined BITS Pilani as an Assistant Lecturer. She was designated as Assistant Professor (in 2003), Associate Professor (in 2010), Professor (in 2016). She is an IEEE Senior member. Her research interests include low power, high performance analog/ digital/ mixed signal design for ASIC applications.
Dr. Jai Gopal Pandey has been working as a Principal Scientist in Council of Scientific and Industrial Research - Central Electronics Engineering Research Institute (CSIR-CEERI), Pilani, since 2005. He has received M.Tech. Degree in Electronics Design and Technology from U. P. Technical University, Lucknow, in 2003 and obtained Ph.D. in Electronics Engineering from Birla Institute of Technology and Science (BITS), Pilani, India in 2015. His research interests include high-performance architecture, SoCs, embedded systems, cryptography, and FPGA-based design. Dr. Pandey is an IETE Fellow, Senior Member of IEEE, and Life Member of the Semiconductor Society of India.
Dr. Devesh Dwivedi is a distinguished professional, currently serving as the Director and India Site Leader at the Design Engineering Center of Excellence (CoE ) for GlobalFoundaries India. With a Ph.D. in Electronics Engineering from IIT BHU, Varanasi, Dr. Devesh has an impressive career spanning over 24 years in the industry. As a Senior IEEE Member, he has contributed significantly to the field with 70+ research publications, 15 US patents, and 2 trade secrets. He actively engages in various conferences, having chaired the IEEE CASS Bangalore Chapter. In the academic realm, Dr. Devesh is a respected visiting faculty member at IIT, NIT, and IIIT since 2012, holding the title of Distinguished Visiting Professor at IIT Roorkee. He has supervised 12 master's and 4 Ph.D. students and serves as a Board Member on the Industry-Academia Consulting Committee.
Dr. Nitin Chaturvedi is Associate Professor in the Department of Electrical & Electronics Engineering, Birla Institute of Technology and Science, Pilani. He has more than 15 years of experience in academia and has contributed several publications in National and International Journals in the area of microelectronics and VLSI design. His interests include high performance cache architectures, CMOS VLSI design, asynchronous circuit design, non-volatile architectures for energy harvesting, in-memory computing, low-power neuromorphic circuit design and hardware security.
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Información sobre el derecho de desistimiento
Derecho legal de desistimiento
Tiene derecho a rescindir este contrato en un plazo de 14 días sin dar ningún motivo.
El periodo de desistimiento vencerá a los 14 días desde que usted, o un tercero que no sea el transportista e indicado por usted, adquiera la posesión física del último bien o del último lote o pieza.
Para ejercer el derecho de desistimiento, complete de forma electrónica y envíe una declaración clara en nuestro sitio web, desde "Mis compras" en "Mi cuenta". Le enviaremos sin demora un acuse de recibo de dicho desistimiento a través de un soporte duradero (por ejemplo, por correo electrónico).
Para cumplir con el plazo de desistimiento, basta con que envíe su comunicación relativa al ejercicio del derecho de desistimiento antes de que venza el periodo de desistimiento.
Efectos del desistimiento
Si rescinde este contrato, le reembolsaremos todos los pagos que hayamos recibido de usted, incluidos los gastos de envío (excepto los gastos adicionales que surjan si elige un tipo de envío que no sea el tipo de envío estándar más económico que ofrecemos).
Podemos hacer una deducción del reembolso por la pérdida de valor de cualquier bien suministrado, si la pérdida es el resultado de una manipulación innecesaria por su parte.
Efectuaremos el reembolso sin demoras indebidas y, a más tardar, 14 días después de que se nos informe de su decisión de rescindir este contrato.
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Deberá devolver los bienes o entregarlos a BuchWeltWeit Ludwig Meier e.K., Bergisch Gladbach, Germany, sin demoras indebidas y, en cualquier caso, en un plazo máximo de 14 días a partir del día en que nos comunique su desistimiento del presente contrato. El plazo se cumple si devuelve la mercancía antes de que venza el periodo de 14 días. Tendrá que asumir los gastos directos de devolución de los bienes. Usted solo es responsable de la disminución del valor de los bienes como resultado de una manipulación distinta a la necesaria para establecer la naturaleza, las características y el funcionamiento de los bienes.
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