Design Of High Speed and Low Power Multiplier

Idioma: inglés

Editorial: LAP LAMBERT Academic Publishing, 2019

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Zustand: Hervorragend | Seiten: 56 | Sprache: Englisch | Produktart: Bücher | Power dissipation is recognized as a critical parameter in modern VLSI field. To produce consumer electronics goods with more backup and less weight, low power VLSI design is necessary.The increasing speed and complexity of today¿s designs implies a significant increase in the power consumption of very-large-scale integration (VLSI) chips. Multiplication is an important part of real-time digital signal processing (DSP) applications ranging from digital filtering to image processing.The Spurious Power Suppression Technique (SPST) uses a detection logic circuit to detect the effective data range of arithmetic units.

N° de ref. del artículo 34304835/1

Título
Design Of High Speed and Low Power Multiplier
Autor
S. Gopalakrishnan, G. Sasi
Editorial
LAP LAMBERT Academic Publishing
Año de publicación
2019
Estado
Hervorragend
Encuadernación
Encuadernación de tapa blanda
Idioma
inglés
ISBN 10
6139461340
ISBN 13
9786139461349
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