CMOS Area Efficient Approximate Arithmetic Architectures

Idioma: inglés

Editorial: LAP LAMBERT Academic Publishing Jun 2017, 2017

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This item is printed on demand - it takes 3-4 days longer - Neuware -Approximate computation provide alternate solution to reduce energy consumption of high performance present day DSP application devices. Conventional multiplication and addition techniques consume a lot of energy. In this brief design of approximate arithmetic units for signal processing application is explored. First an approximate adder is proposed by changing the logic of basic full adder cell. The proposed adder cell has fewer transistor count compared to recent similar approach. Next, an approximate multiplier with low error is designed using lead one detection and selecting n/2 bits for an n bit input. The proposed n/2 bit approximate multiplier performs well in terms of error and power performance compared to recent similar approach. In continuation the approximate units are implemented in a Multiply-Accumulate(MAC) unit. The proposed approximate MAC unit provides significant improvement in power, area, and delay at the cost of little degrade in accuracy. Finally, the proposed MAC unit is implemented in filtering application to verify the functionality. 60 pp. Englisch.…

N° de ref. del artículo 9783330331792

Título
CMOS Area Efficient Approximate Arithmetic Architectures
Autor
Vijeyakumar Krishnasamy Natarajan
Editorial
LAP LAMBERT Academic Publishing Jun 2017
Año de publicación
2017
Estado
Neu
Encuadernación
Taschenbuch
Idioma
inglés
ISBN 10
3330331798
ISBN 13
9783330331792
Peso del artículo
107 gramos
Dimensiones
220x150x4 mm

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